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• importAnnotationsFromJSONRaw() : circt::firrtl
• importFIRFile() : circt::firrtl
• importVerilog() : circt
• inferAddResultType() : circt::hwarith
• inferAddSubResult() : circt::firrtl::impl
• inferBitwiseResult() : circt::firrtl::impl
• inferComparisonResult() : circt::firrtl::impl
• inferElementwiseResult() : circt::firrtl::impl
• inferImplicitSSAName() : circt
• inferReductionResult() : circt::firrtl::impl
• inferStructuralNameForTemporary() : circt::ExportVerilog
• initAllExternalInterfaces() : circt::arc
• innerType() : circt::esi
• insertFork() : circt::handshake
• insertMergeBlocks() : circt
• is2StateExpression() : circt::sv
• is_port_open() : esi-cosim
• isAncestorOfValueOwner() : circt
• isAnyModuleOrInstance() : circt::hw
• isAnyNonFuncSMTValueType() : circt::smt
• isAnySMTValueType() : circt::smt
• isClockOrI1Type() : circt::seq
• isCombinational() : circt::hw
• isConst() : circt::firrtl
• isConstant() : circt::firrtl
• isConstantExpression() : circt::ExportVerilog
• isConstantOne() : circt
• isConstantZero() : circt
• isControlLeafNode() : circt::calyx
• isControlOpImpl() : circt::handshake
• isDuplexValue() : circt::firrtl
• isExpression() : circt::firrtl , circt::sv
• isExpressionAlwaysInline() : circt::ExportVerilog
• isExpressionEmittedInline() : circt::ExportVerilog
• isHWArithIntegerType() : circt::hwarith
• isHWEnumType() : circt::hw
• isHWIntegerType() : circt::hw
• isHWValueType() : circt::hw
• isI1ValueType() : circt::dc
• isMapKeyValuePairType() : circt::om
• isModuleScopedDrivenBy() : circt::firrtl
• isNameValid() : circt::sv
• isOffset() : circt::hw
• isOpaqueScopeRefType() : circt::kanagawa
• isParametricType() : circt::hw
• isRecognizedPrintfEncodedVerif() : circt::firrtl
• isRegionSSAMaximized() : circt
• isSimpleReadOrPort() : circt::ExportVerilog
• isTypeInOut() : circt::firrtl
• isTypeLarger() : circt::firrtl
• isUniDimensional() : circt
• isUselessName() : circt
• isValidDst() : circt::firrtl
• isValidIndexBitWidth() : circt::hw
• isValidIndexValues() : circt::seq
• isValidParameterExpression() : circt::hw
• isValidSrc() : circt::firrtl
• isVerilogExpression() : circt::ExportVerilog
• isZeroBitType() : circt::ExportVerilog